Newscanner

http://www.elektrikforum.de/ftopic16944.html

Abbildung: Bugged.

CPU

Abbildung: TMS 9980 ANL

Bei der CPU handelt es sich um einen 16-bit TI-Microcontroller mit einem internen 2,5MHz Oszillator und maximal 65,536 Byte RAM + ROM (2^15 * 16bit). Mit externem Oszillator kann die CPU mit rund 10MHz betrieben werden.

Die CPU ist ein spar TMS9900 und hat extern ein:

• A0-A13 14Bit 3-state Adressinterface (Pins 4-17)
• D0-D7 8Bit Datenbus (Pins 26-33)
• Vcc 5V (Pin 20)
• Vbb -5V (Pin 21)
• Vdd 12V (Pin 36)
• Vss GND (Pin 35)
• CLK-in Phase 1-4 (Pin 34) CLK = CLK-in / 4
• DBIN (data bus in) (Pin 18) wenn HIGH, dann ist der Datenbus im READ state
• ¬MEMEN (memory enable) (Pin 40) wenn LOW dann ist das Adressregister gesetzt
• ¬WE (write enable) (Pin 38) wenn LOW dann können Daten vom Datenbus geschrieben werden
• To Be Continued

Beschreibung/Anleitung: http://datatomb.de/mirror/Docs/Newscanner/TMS9900_DataManual.pdf
Specs: http://datatomb.de/mirror/Docs/Newscanner/TMS9980.pdf

Speicher (RAM)

Abbildung: Noch leere Speicherbänke, rechts unten einer von bisher 4 x TC5514AP-2

Als RAM findet Toshiba TC5514AP-2 Einsatz, ein CMOS-Speicher mit 4Bit Datenbus und Wortlänge (vermutlich sind je 2 Parallel geschaltet um die 8Bit Wortbeite für den CPU-Datenbus zu erreichen). Der 10Bit Addressbus ist ein simpler Direct-Access-Bus (A0-4 sind die Spalten, A4-9 die Zeilen) der Speicher ist ein 64x64bit großes Array je Spalte 4 Bit.

Wir haben also 2kByte RAM vermutlich in 2048 Wörtern organisiert.

Die Zugriffszeiten sind recht flink (für altes CMOS-ram) mit maximal 200ns.

"Besonderheit": RAM und ROM teilen sich den Speicherbus und damit auch die Adressen, denn nach dem RESET läd die CPU blind die erste Instruktion vom Bus es sei denn sie wird per CRU via direct instruction write and execute injected.

Datenblatt/Anleitung: http://datatomb.de/mirror/Docs/Newscanner/TC5514AP-3.pdf

Interrupt-Controller / I/O-Interface TMS 9901

Abbildung: TMS 9901-95NL

Der TMS 9901 bindet über das CRU-Interface (einfaches Register-Tnterface) und die Interrupt-Lines der CPU, Interrupt kontrollierte I/O-Ports an (6 dedizierte Eingänge, 9 Input/Output-Pins). Außerdem werden 6 weitere nicht Interrupt gesteuerte Ports angebunden.

Der I/O-Controller ist nötig, da die TMS9900 keinerlei I/O Buffer o.ä. haben, wie es bei modernen Microkontrollern üblich ist

Datenblatt/Anleitung: http://datatomb.de/mirror/Docs/Newscanner/TMS9901.pdf

EPROM

1x NEC D2716D EPROM war gesockelt, ein anderer Sockel war frei.

Dump vom 1.2.2012, mehrmaliges Lesen einwandfrei, Bitfehler wg. Lagerzeit im Vergleich zum Originalinhalt aber immer möglich - einziges Klartextvorkommen ist "STORE FULL ( NEWSCANNER )" fast am Ende der Daten:

Abbildung: NEC D2716D

begin-base64 644 newscan.bin
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====

Backup Battery

War ausgelaufen (=> Grünspan auf einigen Leiterbahnen) und wurde entfernt: Varta Mempac 3.6v 100mAh

Abbildung: Varta Mempac 3.6v 100mAh

=> 3/V150H/2P Varta Herst.-Nr.: 55615603940

Linksammlung

• http://www.seekic.com/pdf/index.html?sel1=3&keyword=TMS9901
• http://www.chinaicmart.com/pdf/index.html?keyword=TMS9980
• http://www.bitsavers.org/pdf/ti/_dataBooks/
• http://www.youtube.com/watch?v=EJlgik3ho48 Testing The 74LS138 Decoder
• http://www.datasheetarchive.com/UA556PC-datasheet.html 556 Timer Datasheet